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發(fā)表于:2019-06-04
作者:科翔信息
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專利申請(qǐng)?zhí)?/span>:
CN201110128633.7
專利類型:
發(fā)明
IPC 分類號(hào):
G01S7/02 G01S13/90
應(yīng)用領(lǐng)域:
用于實(shí)時(shí)成像。
現(xiàn)有技術(shù)缺點(diǎn):
目前尚無多片 FPGA 并行處理的系統(tǒng)結(jié)構(gòu)、數(shù)據(jù)分布式存儲(chǔ)、以及針對(duì)多種 SAR 工作模式數(shù)據(jù)處理的方案。
技術(shù)優(yōu)勢(shì):
在使用了較少的 FPGA 資源情況下,提高了 SAR 圖像方位向和距離向的峰值旁瓣比(PLSR)和積分旁瓣比(ISLR),在保證圖像分辨率的同時(shí),使方位向和距離向的峰值旁瓣比(PLSR)和積分旁瓣比(ISLR)都達(dá)到一定指標(biāo)要求。
摘要:
本發(fā)明涉及一種基于 FPGA 的 SAR 成像系統(tǒng)的二維加窗方法,包括: 步驟 A,傳入輸入輸出板的 SAR 原始數(shù)據(jù)經(jīng)主 FPGA 進(jìn)行原始數(shù)據(jù)分發(fā),同時(shí),主 FPGA 控制協(xié)調(diào) N 片從 FPGA,其中 N≥1;步驟 B,并行的、配有存儲(chǔ)器的 N 片從 FPGA 對(duì)分發(fā)后的數(shù)據(jù)進(jìn)行處理,從 FPGA 完成二維加窗運(yùn)算處理,在運(yùn)算過程中從 FPGA 對(duì)相應(yīng)運(yùn)算后的數(shù)據(jù)進(jìn)行二維加窗位置選擇,實(shí)現(xiàn)二維加窗,本發(fā)明在使用了較少的FPGA 資源情況下,提高了 SAR 圖像方位向和距離向的峰值旁瓣比和積分旁瓣比,在保證圖像分辨率的同時(shí),使方位向和距離向的峰值旁瓣比和積分旁瓣比都達(dá)到一定指標(biāo)要求。
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